Altera accélère la productivité du design fpga avec la version 10. 1 de Quartus II et le nouvel outil d'intégration système








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Altera accélère la productivité du design FPGA avec la version 10.1 de Quartus II et le nouvel outil d'intégration système.


Le nouvel outil Qsys permet de développer plus rapidement les systèmes.

Vélizy -- 6 décembre 2010 -- Altera Corporation (NASDAQ:ALTR) annonce la version 10.1 de son logiciel de développement Quartus® II, premier logiciel du marché de la logique programmable en performances et en productivité pour la conception de CPLD, FPGA et d'ASIC® HardCopy. La version 10.1 de Quartus II Subscription Edition comprend la version beta de Qsys, nouvel outil d'intégration système d'Altera, qui intègre la première interconnexion basé sur un network-on-chip et optimisé pour les FPGA. Qsys propose une prise en charge d'une interface en continu et de mappage en mémoire pour presque doubler les performances de l'outil SOPC Builder d'Altera, tout en améliorant l'évolutivité système pour de grands designs FPGA et permettre de prendre en charge des interfaces standards (Avalon, AMBA AXI et AHD d'ARM, etc.).
Qsys permet de concevoir des systèmes basés sur des FPGA à hautes performances grâce à l'utilisation d'une architecture d'interconnexion network-on-chip. Qsys applique la théorie du réseau sur les communications de la puce pour améliorer les performances par rapport à un bus conventionnel et des interconnexions switch fabric. Cette approche, qui groupe par paquets toutes les données en continu et en mappage mémoire, augmente la fréquence de fonctionnement pour le même temps de latence et d'utilisation des ressources. Qsys propose également une fonction de pipeline automatique pour accroître le fMAX système.
Les designs qui intègrent une dose élevée de propriété intellectuelle (IP) ou de composants système bénéficient du flot de conception hiérarchique présent dans Qsys. Cet outil permet une évolutivité du système en divisant de grands designs FPGA en plusieurs sous-systèmes. Cette hiérarchie permet aux concepteurs de gérer facilement chaque sous-système tout en leur permettant d'ajouter des sous-systèmes supplémentaires dans le design avec un minimum d'impact sur les performances système.
Qsys élargit le nombre d'IP disponibles pour concevoir un système basé sur des FPGA grâce à la prise en charge d'interfaces standards comme Avalon, AMBA AXI et AHB d'ARM. Cet outil apporte une flexibilité extrême en gérant automatiquement le pont entre plusieurs interfaces standards. Cette capacité permet de s'appuyer sur les coeurs IP avec plusieurs interfaces dans un même design. Qsys prend initialement en charge l'interface ouverte Avalon. D'autres interfaces comme AMBA AXI et AHB d'ARM seront prises en charge dans les prochaines versions. Pour des informations complémentaires sur Qsys, visitez : www.altera.com/qsys.
Accord OEM étendu à ModelSim et prise en charge de la simulation
Altera reconnait l'importance de la simulation dans le processus de design FPGA et la société améliore celle-ci avec la dernière version de son logiciel de conception Quartus II. Altera a récemment renouvelé son accord OEM pluri-annuel avec Mentor Graphics, qui permet aux clients de Quartus II d'accéder à la nouvelle version de l'outil ModelSim. Parmi les nouvelles fonctions dans l'édition ModelSim-Altera et la starter edition ModelSim-Altera : un waveform editor et une meilleure prise en charge du simulateur Altera IP. L'outil waveform editing prend en charge une méthode bien connue qui génère rapidement les stimulus en entrée pour les vérifier.
Fonctions additionnelles de la version 10.1 de Quartus II :


  • Prend en charge de nouveaux circuits - cette version apporte un support complet à la nouvelle gamme de CPLD MAX® V annoncée également le même jour. Prise en charge aussi de la nouvelle gamme de FPGA Arria® II GZ et support élargi au FPGA Stratix V.

  • Recompile plus rapidement - améliorations sur la fonction Rapid Recompile du logiciel pour augmenter la productivité du designer et réduire ainsi de 65% en moyenne le temps de recompilation

  • Nouveau toolkit d'interface mémoire externe - ce nouveau toolkit permet aux concepteurs de créer plus vite leurs cartes en identifiant les problèmes de calibrage et en mesurant les marges de chaque signal DQS (DQ strobe).

  • Améliorations de Chip Planner et TimeQuest - le Chip Planner intègre une nouvelle fenêtre pour que les concepteurs puissent facilement scruter les nombreux chemins de timing critiques. TimeQuest ajoute la possibilité de faire un rapport sur les recommandations de clôture temporelle pour que les concepteurs puissent les identifier rapidement et facilement et résoudre les problèmes s'y rapportant.

Pour toute information complémentaire sur les fonctions de Quartus II v10.1, visitez : www.altera.com/q2whatsnew.
Prix et Disponibilité
Les éditions Subscription et Web (gratuite) de Quartus II v10.1 sont disponibles par simple téléchargement. Une version beta de Qsys est disponible avec la Subscription Edition. Le programme de souscription logiciel d'Altera simplifie l'obtention du logiciel de conception d'Altera en consolidant le prix des logiciels et de la maintenance en un seul règlement annuel. Les souscripteurs reçoivent le logiciel Quartus II, ModelSim-Altera Starter Edition et une licence complète de l'IP Base Suite, qui comprend 16 des coeurs IP (DSP et mémoire) les plus connus d'Altera. La souscription annuelle est de 2 995 $ pour une licence PC et est disponible à l’achat sur Altera eStore.

À propos d’Altera
Les solutions programmables d’Altera permettent aux sociétés de systèmes et de semiconducteurs d’innover, de se différencier et de gagner sur leur marché rapidement et économiquement. Pour en savoir plus sur les FPGA, CPLD, ASIC d’Altera, visitez : www.altera.com. Suivez Altera aussi sur Facebook, RSS et Twitter.

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